Zusammenfassung
Die Devise der ersten vier Generationen von Rechnersystemen lautete “schneller, schneller” /1/ und später, seit den erstaunlichen Errungenschaften der VLSI-Techno-logie auch “kleiner, noch kleiner”. Stets stand eine im wesentlichen auf die Quantität abzielende Entwicklung im Vordergrund.
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Literatur
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vgl. z. B. Moritzen, K.: Softwarehilfsmittel zur Programmierung von Multipro-zessoren mit begrenzten Nachbarschaften — Ein Beitrag zur Konfigurationsverwaltung (Dissertation, Erlangen 1986)
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vgl. z. B. Wilkes, J.L.: Architecture of a VLSI multiple ISA Emulator; MICRO 17, The Seventeenth Annual Microprogramming Workshop (IEEE CS, ACM SIGMICR0)
Die heute üblichen Prozessoren gehen auf folgende Arbeit zurück: Burks, A.W., H.H. Goldstine, J. von Neumann: Prelininary discussion of the logical design of an electronic computing instrument (hectogr. 1946); Reprint in Randell, B. (edet.) The Origins of Digital Computers; Springer-Verlag: Berlin-Heidelberg-New York (1973), S. 371–385
Organick, E.I.: Computer System Organization, The B5700/B6700 Series; Academic Press, New York, London, (1973)
Berkling, K.J.: A computing machine based on tree structures; IEEE Transactions on Computers; Vol. C-20, (1971), No. 4, S. 404–418
Dennis, J.B.: Data flow supercomputers; Computer 13, (1980), No. 11, S. 48–56
Batcher, K.E.: STARAN, Series E; Proc. of the 1977 International Conference on Parallel Processing, J.L. Baer (edit.), 1977, S. 140–143
vgl. aber auch: Bode, A.: Vertical Processing: The emulation of associative. and parallel behavior on conventional hardware; Microprocessor Systems, M. Sami, L. Thompson, L. Mezallira (eds.), (North-Holland), EUROMICRO, (1980), S. 215–220
Legendi, T.: Cellular algorithms and their verification; in Lecture Notes in Computer Science, Vol. 111, C0NPAR 81, Proc, Nürnberg, June 10–12, 1981 by W. Händler, Springer-Verlag: Berlin-Heidelberg-New York (1981)
vgl. z. B.: Ameling, W.: The development and application of Digital Differential analyzers; in Parallel Computers — Parallel Mathematics, S. 31–38, edit.: M. Feilmeier, North-Holland, Amsterdam, (1977)
Kluge, W.E.: The Architecture of a Reduction Machine Hardware Model; GMD-Be-richt, ISF — 79 – 3, Aug. 1979 (Bonn)
vgl. z. B.: Händler, W.: 10.1. Digitale Universalrechenautomaten; in K. Steinbuch (edit.), S. 1009–1139 bzw. speziell S. 1092/1093
Händler, W.: The concept of Macro-Pipelining with high availability; Elektronische Rechenanlagen 15 (1973), S. 269 ff
vgl. u.a. (o. Verf.): A new direction in scientific computing; INTEL-Corp., 1985
MCC: Multi-Chip-Carrier, vgl. verschiedene Unterlagen der Firma IBM. Anm.: Gitterförmiger Keramik-Körper nimmt eine Vielzahl von Chips auf, die in dieser Form direkt “gebondet” werden. Enorme Platz-Ersparnis gegenüber der gegenwärtig noch üblichen Technik, nach der jedes einzelne Chip einzeln einen Keramik-Träger erhält und einzeln “gebondet” wird.
vgl. auch /8/, für Rechenanlagen auf optischer Basis (Photonen statt Elektronen!), vgl.
Abraham, E., C.T. Seaton und S.D. Smith: Der optische Computer; Spektrum der Wissenschaft 4 (1983), S. 46–56 (April-Heft, Wiedergabe in deutsch aus dem Original: Scientific American, Febr. 1983)
Bobrow, D.G.: If PROLOG is the Answer, what is the Question; Proc. of the International Conference on Fifth Generation Computer Systems 1984 (edit. by ICOT, 1984), S. 138–145
Händler, W.: Wandlungen im Verhältnis zwischen Mensch und Maschine; Arbeitsberichte IMMD 2 (1969), S. 5–27, Universität Erlangen-Nürnberg
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Händler, W. (1986). Fünfte Computer-Generation und zukünftige Rechnerstrukturen. In: Schulz, A. (eds) Die Zukunft der Informationssysteme Lehren der 80er Jahre. Betriebs- und Wirtschaftsinformatik, vol 17. Springer, Berlin, Heidelberg. https://doi.org/10.1007/978-3-642-71384-2_2
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