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Einheitliche Modellierung mit VHDL-A

  • Eduard Moser
  • Reinhard Neul
Part of the Fortschritte in der Simulationstechnik book series (XFS)

Kurzfassung

Der Bedarf einer einheitlichen Modellierung ist bereits hinlänglich aufgezeigt worden. Mit IEEE PAR 1076.1, der analogen Erweiterung zu VHDL, erscheint diese Aufgabe lösbar zu sein und eine geeignetet Basis für Anwender und Werkzeugmacher zu liefern. Dies Papier diskutiert die Konzepte der Sprache in Hinblick auf den Entwurf von Steuerungs- und Regelungssystemen.

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Copyright information

© Springer Fachmedien Wiesbaden 1996

Authors and Affiliations

  • Eduard Moser
    • 1
  • Reinhard Neul
    • 1
  1. 1.Corporate Research and DevelopmentRobert Bosch GmbHStuttgartGermany

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